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// Copyright     :  Copyright (C) 2021, Hisilicon Technologies Co. Ltd.
// File name     :  mpu_harden_reg_offset.h
// Project line  :  Platform And Key Technologies Development
// Department    :  CAD Development Department
// Author        :  xxx
// Version       :  1.0
// Date          :  2021/06/26
// Description   :  The description of xxx project
// Others        :  Generated automatically by nManager V5.1
// History       :  xxx 2021/06/26 17:53:27 Create file
// ******************************************************************************

#ifndef MPU_HARDEN_REG_OFFSET_H
#define MPU_HARDEN_REG_OFFSET_H

/* MPU_HARDEN_NODE_CSR Base address of Module's Register */
#define CSR_MPU_HARDEN_NODE_CSR_BASE (0x21F90000)

/* **************************************************************************** */
/*                      MPU_HARDEN_NODE_CSR Registers' Definitions                            */
/* **************************************************************************** */

#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_MPU_HARDEN_0_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x0) /* MPU_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_MPU_HARDEN_1_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x4) /* MPU_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_MPU_HARDEN_2_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x8) /* MPU_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_PCIE_RC_HARDEN_0_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0xC) /* PCIE_RC_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_PCIE_RC_HARDEN_1_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x10) /* PCIE_RC_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_PCIE_RC_POWER_CFG_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x14) /* PCIE_RC power控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_PCIE_RC_POWER_ACK_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x18) /* PCIE_RC power ACK状态寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_CRG_CFG_LCAM_HARDEN_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x1C) /* LCAM_HARDEN CRG的控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_RING_STA_MPU_HARDEN_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x20)  /* RING_CRDT_STA */
#define CSR_MPU_HARDEN_NODE_CSR_RING_STA_LCAM_HARDEN_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x24) /* RING_CRDT_STA */
#define CSR_MPU_HARDEN_NODE_CSR_DCIP_CFG_0_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x28)           /* DCIP的config寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_DCIP_CFG_1_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2C)           /* DCIP的config寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_DCIP_STATUS_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x30)          /* DCIP的状态寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_PAD_IN_STATUS_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x34) /* pad的一些关键配置信号状态 \
                                                                                         */
#define CSR_MPU_HARDEN_NODE_CSR_DFT_MPU_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x38)       /* MPU DFT相关配置信号 */
#define CSR_MPU_HARDEN_NODE_CSR_HISS_CTRL_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x3C)     /* HISS 相关控制信号 */
#define CSR_MPU_HARDEN_NODE_CSR_HISS_CTRL_STATUS_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x40) /* HISS 相关状态信号 */
#define CSR_MPU_HARDEN_NODE_CSR_TILE_JTAG_EN_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x44)     /* tile_jtag_en使能信号 */
#define CSR_MPU_HARDEN_NODE_CSR_CFG_MPU_CPL_ICL_MEM_CTRL_BUS_0_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x48) /* mem ctrl bus 信号 */
#define CSR_MPU_HARDEN_NODE_CSR_CFG_MPU_CPL_ICL_MEM_CTRL_BUS_1_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x4C) /* mem ctrl bus 信号 */
#define CSR_MPU_HARDEN_NODE_CSR_CFG_MPU_CPL_ICL_MEM_CTRL_BUS_2_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x50) /* mem ctrl bus 信号 */
#define CSR_MPU_HARDEN_NODE_CSR_CFG_MPU_CPL_ICL_MEM_CTRL_BUS_3_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x54) /* mem ctrl bus 信号 */
#define CSR_MPU_HARDEN_NODE_CSR_CFG_MPU_CPL_ICL_MEM_CTRL_BUS_4_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x58) /* mem ctrl bus 信号 */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_0_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x200) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_1_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x204) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_2_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x208) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_3_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x20C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_4_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x210) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_5_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x214) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_6_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x218) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_7_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x21C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_8_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x220) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_9_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x224) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_10_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x228) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_11_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x22C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_12_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x230) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_13_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x234) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_14_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x238) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_15_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x23C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_16_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x240) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_17_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x244) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_18_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x248) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_19_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x24C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_20_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x250) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_21_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x254) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_22_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x258) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_23_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x25C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_24_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x260) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_25_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x264) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_26_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x268) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_27_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x26C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_28_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x270) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_29_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x274) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_30_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x278) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_31_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x27C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_32_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x280) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_33_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x284) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_34_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x288) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_35_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x28C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_36_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x290) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_37_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x294) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_38_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x298) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_39_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x29C) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_40_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2A0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_41_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2A4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_42_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2A8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_43_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2AC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_44_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2B0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_45_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2B4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_46_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2B8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_47_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2BC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_48_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2C0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_49_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2C4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_50_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2C8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_51_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2CC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_52_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2D0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_53_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2D4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_54_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2D8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_55_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2DC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_56_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2E0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_57_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2E4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_58_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2E8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_59_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2EC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_60_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2F0) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_61_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2F4) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_62_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2F8) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_2K_63_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x2FC) /* efuse 2k die id[2047:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_0_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x300) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_1_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x304) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_2_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x308) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_3_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x30C) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_4_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x310) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_5_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x314) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_6_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x318) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_7_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x31C) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_8_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x320) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_9_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x324) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_10_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x328) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_11_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x32C) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_12_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x330) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_13_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x334) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_14_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x338) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_15_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x33C) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_16_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x340) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_17_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x344) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_18_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x348) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_19_REG \
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#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_126_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x4F8) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_DIE_ID_4K_127_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x4FC) /* efuse 4k die id[4095:0] */
#define CSR_MPU_HARDEN_NODE_CSR_DJTAG_CLK_DIV_NUM_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x500) /* djtag clk分频寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_ICG_EN_KISDON_TAP_TCK_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x504) /* kisdon tap tck icg en使能寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_SFC_DQ3_CTRL_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x508) /* sfc dq3引脚控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_NODE_APB_PSLVERR_PAD_CFG_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x50C)                                                /* apb pslverr 控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_JTAG_AUTH_CTRL_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x510) /* JTAG_AUTH控制寄存器 */
#define CSR_MPU_HARDEN_NODE_CSR_JTAG_AUTH_RESULT_0_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x514)  /* JTAG_AUTH_RESULT */
#define CSR_MPU_HARDEN_NODE_CSR_JTAG_AUTH_RESULT_1_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x518)  /* JTAG_AUTH_RESULT */
#define CSR_MPU_HARDEN_NODE_CSR_JTAG_HEART_BEAT_NUM_REG (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x51C) /* JTAG_HEART_BEAT_NUM \
                                                                                                */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_SW_RST_N_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x520) /* func efuse software reset */
#define CSR_MPU_HARDEN_NODE_CSR_EFUSE_REPAIR_DONE_REG \
    (CSR_MPU_HARDEN_NODE_CSR_BASE + 0x524) /* efuse repair done stauts */

#endif // __CSR_REG_OFFSET_H__
